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시간 제한 조건을 가진 자유 선택 신호 전이 그래프로부터 비동기 회로의 합성 = Synthesis of asynchronous circuits from free-choice signal transition graphs with timing constraints
표제/저자사항
시간 제한 조건을 가진 자유 선택 신호 전이 그래프로부터 비동기 회로의 합성 = Synthesis of asynchronous circuits from free-choice signal transition graphs with timing constraints / 정성태, 정석태
형태사항
p. 61-74; 30 cm
주기사항
수록자료: 정보처리학회논문지.A. 한국정보처리학회. 9-A권 1호(2002년 3월), p. 61-74 9-A:1<61 상세보기 ISSN 1598-2831
저자: 정성태, 정회원:원광대학교 컴퓨터및정보통신공학부 교수
저자: 정석태, 정회원:원광대학교 컴퓨터및정보통신공학부 교수
저자: 정성태, 정회원:원광대학교 컴퓨터및정보통신공학부 교수
저자: 정석태, 정회원:원광대학교 컴퓨터및정보통신공학부 교수
출처
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001KMO201509136
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24500▼a생명이란 무엇인가? :▼b생명·환경·문화 8월 대 토론회 /▼d주최: 토지문화재단 ;▼e주관: 한국생명윤리학회,▼e토지문화관
260 ▼a원주 :▼b토지문화재단,▼c2001
300 ▼a81 p. ;▼c30 cm
500 ▼a일시 및 장소: 2001년 8월 18일(토) ~ 19일(일), 토지문화관
504 ▼a참고문헌 수록
650 8▼a생명 과학[生命科學]
650 8▼a생명론[生命論]
710 ▼a토지문화재단
710 ▼a한국생명윤리학회
710 ▼a토지문화관
9501 ▼a가격불명
담당부서 : 국가서지과 (02-590-6339)
